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FPGA的多路数据并行录取和时序资源优化

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摘要 PCIe总线在雷达系统中应用日益广泛，但FPGA内部集成的PCIe硬核数量有限，难以满足雷达并行录取多种数据的需求。为此，本文提出了一种改进的PCIeDMA数据传输方法，利用XilinxFPGA集成的单个PCIe硬核实现了多路数据在高速传输情况下的并行录取。针对实现过程中遇到的时序问题，提出了采用多级FIFO级联方法进行时序优化。依据XilinxFPGA的时钟网络特点，对时钟资源进行优化，便于日后系统的扩展和升级。

DOI ojn5kz9gjr/1746613

作者苏阳;赵英潇;黄睿;张月;陈曾平

机构地区不详

出处《单片机与嵌入式系统应用》 2017年7期

关键词 FPGA PCIE 并行录取时序优化

分类 [自动化与计算机技术][计算机系统结构]

出版日期 2017年07月17日（中国期刊网平台首次上网日期，不代表论文的发表时间）

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来源期刊

单片机与嵌入式系统应用

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